drivers/gpu/drm/amd/amdgpu/amdgpu_drv.c

   1 /**
   2  * \file amdgpu_drv.c
   3  * AMD Amdgpu driver
   4  *
   5  * \author Gareth Hughes <[email protected]>
   6  */
   7
   8 /*
   9  * Copyright 2000 VA Linux Systems, Inc., Sunnyvale, California.
  10  * All Rights Reserved.
  11  *
  12  * Permission is hereby granted, free of charge, to any person obtaining a
  13  * copy of this software and associated documentation files (the "Software"),
  14  * to deal in the Software without restriction, including without limitation
  15  * the rights to use, copy, modify, merge, publish, distribute, sublicense,
  16  * and/or sell copies of the Software, and to permit persons to whom the
  17  * Software is furnished to do so, subject to the following conditions:
  18  *
  19  * The above copyright notice and this permission notice (including the next
  20  * paragraph) shall be included in all copies or substantial portions of the
  21  * Software.
  22  *
  23  * THE SOFTWARE IS PROVIDED "AS IS", WITHOUT WARRANTY OF ANY KIND, EXPRESS OR
  24  * IMPLIED, INCLUDING BUT NOT LIMITED TO THE WARRANTIES OF MERCHANTABILITY,
  25  * FITNESS FOR A PARTICULAR PURPOSE AND NONINFRINGEMENT.  IN NO EVENT SHALL
  26  * VA LINUX SYSTEMS AND/OR ITS SUPPLIERS BE LIABLE FOR ANY CLAIM, DAMAGES OR
  27  * OTHER LIABILITY, WHETHER IN AN ACTION OF CONTRACT, TORT OR OTHERWISE,
  28  * ARISING FROM, OUT OF OR IN CONNECTION WITH THE SOFTWARE OR THE USE OR
  29  * OTHER DEALINGS IN THE SOFTWARE.
  30  */
  31
  32 #include <drm/drmP.h>
  33 #include <drm/amdgpu_drm.h>
  34 #include <drm/drm_gem.h>
  35 #include "amdgpu_drv.h"
  36
  37 #include <drm/drm_pciids.h>
  38 #include <linux/console.h>
  39 #include <linux/module.h>
  40 #include <linux/pm_runtime.h>
  41 #include <linux/vga_switcheroo.h>
  42 #include "drm_crtc_helper.h"
  43
  44 #include "amdgpu.h"
  45 #include "amdgpu_irq.h"
  46
  47 #include "amdgpu_amdkfd.h"
  48
  49 /*
  50  * KMS wrapper.
  51  * - 3.0.0 - initial driver
  52  * - 3.1.0 - allow reading more status registers (GRBM, SRBM, SDMA, CP)
  53  * - 3.2.0 - GFX8: Uses EOP_TC_WB_ACTION_EN, so UMDs don't have to do the same
  54  *           at the end of IBs.
  55  * - 3.3.0 - Add VM support for UVD on supported hardware.
  56  * - 3.4.0 - Add AMDGPU_INFO_NUM_EVICTIONS.
  57  * - 3.5.0 - Add support for new UVD_NO_OP register.
  58  * - 3.6.0 - kmd involves use CONTEXT_CONTROL in ring buffer.
  59  * - 3.7.0 - Add support for VCE clock list packet
  60  * - 3.8.0 - Add support raster config init in the kernel
  61  * - 3.9.0 - Add support for memory query info about VRAM and GTT.
  62  * - 3.10.0 - Add support for new fences ioctl, new gem ioctl flags
  63  * - 3.11.0 - Add support for sensor query info (clocks, temp, etc).
  64  * - 3.12.0 - Add query for double offchip LDS buffers
  65  * - 3.13.0 - Add PRT support
  66  * - 3.14.0 - Fix race in amdgpu_ctx_get_fence() and note new functionality
  67  * - 3.15.0 - Export more gpu info for gfx9
  68  * - 3.16.0 - Add reserved vmid support
  69  * - 3.17.0 - Add AMDGPU_NUM_VRAM_CPU_PAGE_FAULTS.
  70  */
  71 #define KMS_DRIVER_MAJOR        3
  72 #define KMS_DRIVER_MINOR        17
  73 #define KMS_DRIVER_PATCHLEVEL   0
  74
  75 int amdgpu_vram_limit = 0;
  76 int amdgpu_gart_size = -1; /* auto */
  77 int amdgpu_moverate = -1; /* auto */
  78 int amdgpu_benchmarking = 0;
  79 int amdgpu_testing = 0;
  80 int amdgpu_audio = -1;
  81 int amdgpu_disp_priority = 0;
  82 int amdgpu_hw_i2c = 0;
  83 int amdgpu_pcie_gen2 = -1;
  84 int amdgpu_msi = -1;
  85 int amdgpu_lockup_timeout = 0;
  86 int amdgpu_dpm = -1;
  87 int amdgpu_fw_load_type = -1;
  88 int amdgpu_aspm = -1;
  89 int amdgpu_runtime_pm = -1;
  90 unsigned amdgpu_ip_block_mask = 0xffffffff;
  91 int amdgpu_bapm = -1;
  92 int amdgpu_deep_color = 0;
  93 int amdgpu_vm_size = -1;
  94 int amdgpu_vm_block_size = -1;
  95 int amdgpu_vm_fault_stop = 0;
  96 int amdgpu_vm_debug = 0;
  97 int amdgpu_vram_page_split = 512;
  98 int amdgpu_exp_hw_support = 0;
  99 int amdgpu_sched_jobs = 32;
 100 int amdgpu_sched_hw_submission = 2;
 101 int amdgpu_no_evict = 0;
 102 int amdgpu_direct_gma_size = 0;
 103 unsigned amdgpu_pcie_gen_cap = 0;
 104 unsigned amdgpu_pcie_lane_cap = 0;
 105 unsigned amdgpu_cg_mask = 0xffffffff;
 106 unsigned amdgpu_pg_mask = 0xffffffff;
 107 char *amdgpu_disable_cu = NULL;
 108 char *amdgpu_virtual_display = NULL;
 109 unsigned amdgpu_pp_feature_mask = 0xffffffff;
 110 int amdgpu_ngg = 0;
 111 int amdgpu_prim_buf_per_se = 0;
 112 int amdgpu_pos_buf_per_se = 0;
 113 int amdgpu_cntl_sb_buf_per_se = 0;
 114 int amdgpu_param_buf_per_se = 0;
 115 int amdgpu_job_hang_limit = 0;
 116 int amdgpu_lbpw = -1;
 117
 118 MODULE_PARM_DESC(vramlimit, "Restrict VRAM for testing, in megabytes");
 119 module_param_named(vramlimit, amdgpu_vram_limit, int, 0600);
 120
 121 MODULE_PARM_DESC(gartsize, "Size of PCIE/IGP gart to setup in megabytes (32, 64, etc., -1 = auto)");
 122 module_param_named(gartsize, amdgpu_gart_size, int, 0600);
 123
 124 MODULE_PARM_DESC(moverate, "Maximum buffer migration rate in MB/s. (32, 64, etc., -1=auto, 0=1=disabled)");
 125 module_param_named(moverate, amdgpu_moverate, int, 0600);
 126
 127 MODULE_PARM_DESC(benchmark, "Run benchmark");
 128 module_param_named(benchmark, amdgpu_benchmarking, int, 0444);
 129
 130 MODULE_PARM_DESC(test, "Run tests");
 131 module_param_named(test, amdgpu_testing, int, 0444);
 132
 133 MODULE_PARM_DESC(audio, "Audio enable (-1 = auto, 0 = disable, 1 = enable)");
 134 module_param_named(audio, amdgpu_audio, int, 0444);
 135
 136 MODULE_PARM_DESC(disp_priority, "Display Priority (0 = auto, 1 = normal, 2 = high)");
 137 module_param_named(disp_priority, amdgpu_disp_priority, int, 0444);
 138
 139 MODULE_PARM_DESC(hw_i2c, "hw i2c engine enable (0 = disable)");
 140 module_param_named(hw_i2c, amdgpu_hw_i2c, int, 0444);
 141
 142 MODULE_PARM_DESC(pcie_gen2, "PCIE Gen2 mode (-1 = auto, 0 = disable, 1 = enable)");
 143 module_param_named(pcie_gen2, amdgpu_pcie_gen2, int, 0444);
 144
 145 MODULE_PARM_DESC(msi, "MSI support (1 = enable, 0 = disable, -1 = auto)");
 146 module_param_named(msi, amdgpu_msi, int, 0444);
 147
 148 MODULE_PARM_DESC(lockup_timeout, "GPU lockup timeout in ms (default 0 = disable)");
 149 module_param_named(lockup_timeout, amdgpu_lockup_timeout, int, 0444);
 150
 151 MODULE_PARM_DESC(dpm, "DPM support (1 = enable, 0 = disable, -1 = auto)");
 152 module_param_named(dpm, amdgpu_dpm, int, 0444);
 153
 154 MODULE_PARM_DESC(fw_load_type, "firmware loading type (0 = direct, 1 = SMU, 2 = PSP, -1 = auto)");
 155 module_param_named(fw_load_type, amdgpu_fw_load_type, int, 0444);
 156
 157 MODULE_PARM_DESC(aspm, "ASPM support (1 = enable, 0 = disable, -1 = auto)");
 158 module_param_named(aspm, amdgpu_aspm, int, 0444);
 159
 160 MODULE_PARM_DESC(runpm, "PX runtime pm (1 = force enable, 0 = disable, -1 = PX only default)");
 161 module_param_named(runpm, amdgpu_runtime_pm, int, 0444);
 162
 163 MODULE_PARM_DESC(ip_block_mask, "IP Block Mask (all blocks enabled (default))");
 164 module_param_named(ip_block_mask, amdgpu_ip_block_mask, uint, 0444);
 165
 166 MODULE_PARM_DESC(bapm, "BAPM support (1 = enable, 0 = disable, -1 = auto)");
 167 module_param_named(bapm, amdgpu_bapm, int, 0444);
 168
 169 MODULE_PARM_DESC(deep_color, "Deep Color support (1 = enable, 0 = disable (default))");
 170 module_param_named(deep_color, amdgpu_deep_color, int, 0444);
 171
 172 MODULE_PARM_DESC(vm_size, "VM address space size in gigabytes (default 64GB)");
 173 module_param_named(vm_size, amdgpu_vm_size, int, 0444);
 174
 175 MODULE_PARM_DESC(vm_block_size, "VM page table size in bits (default depending on vm_size)");
 176 module_param_named(vm_block_size, amdgpu_vm_block_size, int, 0444);
 177
 178 MODULE_PARM_DESC(vm_fault_stop, "Stop on VM fault (0 = never (default), 1 = print first, 2 = always)");
 179 module_param_named(vm_fault_stop, amdgpu_vm_fault_stop, int, 0444);
 180
 181 MODULE_PARM_DESC(vm_debug, "Debug VM handling (0 = disabled (default), 1 = enabled)");
 182 module_param_named(vm_debug, amdgpu_vm_debug, int, 0644);
 183
 184 MODULE_PARM_DESC(vram_page_split, "Number of pages after we split VRAM allocations (default 1024, -1 = disable)");
 185 module_param_named(vram_page_split, amdgpu_vram_page_split, int, 0444);
 186
 187 MODULE_PARM_DESC(exp_hw_support, "experimental hw support (1 = enable, 0 = disable (default))");
 188 module_param_named(exp_hw_support, amdgpu_exp_hw_support, int, 0444);
 189
 190 MODULE_PARM_DESC(sched_jobs, "the max number of jobs supported in the sw queue (default 32)");
 191 module_param_named(sched_jobs, amdgpu_sched_jobs, int, 0444);
 192
 193 MODULE_PARM_DESC(sched_hw_submission, "the max number of HW submissions (default 2)");
 194 module_param_named(sched_hw_submission, amdgpu_sched_hw_submission, int, 0444);
 195
 196 MODULE_PARM_DESC(ppfeaturemask, "all power features enabled (default))");
 197 module_param_named(ppfeaturemask, amdgpu_pp_feature_mask, int, 0444);
 198
 199 MODULE_PARM_DESC(no_evict, "Support pinning request from user space (1 = enable, 0 = disable (default))");
 200 module_param_named(no_evict, amdgpu_no_evict, int, 0444);
 201
 202 MODULE_PARM_DESC(direct_gma_size, "Direct GMA size in megabytes (max 96MB)");
 203 module_param_named(direct_gma_size, amdgpu_direct_gma_size, int, 0444);
 204
 205 MODULE_PARM_DESC(pcie_gen_cap, "PCIE Gen Caps (0: autodetect (default))");
 206 module_param_named(pcie_gen_cap, amdgpu_pcie_gen_cap, uint, 0444);
 207
 208 MODULE_PARM_DESC(pcie_lane_cap, "PCIE Lane Caps (0: autodetect (default))");
 209 module_param_named(pcie_lane_cap, amdgpu_pcie_lane_cap, uint, 0444);
 210
 211 MODULE_PARM_DESC(cg_mask, "Clockgating flags mask (0 = disable clock gating)");
 212 module_param_named(cg_mask, amdgpu_cg_mask, uint, 0444);
 213
 214 MODULE_PARM_DESC(pg_mask, "Powergating flags mask (0 = disable power gating)");
 215 module_param_named(pg_mask, amdgpu_pg_mask, uint, 0444);
 216
 217 MODULE_PARM_DESC(disable_cu, "Disable CUs (se.sh.cu,...)");
 218 module_param_named(disable_cu, amdgpu_disable_cu, charp, 0444);
 219
 220 MODULE_PARM_DESC(virtual_display,
 221                  "Enable virtual display feature (the virtual_display will be set like xxxx:xx:xx.x,x;xxxx:xx:xx.x,x)");
 222 module_param_named(virtual_display, amdgpu_virtual_display, charp, 0444);
 223
 224 MODULE_PARM_DESC(ngg, "Next Generation Graphics (1 = enable, 0 = disable(default depending on gfx))");
 225 module_param_named(ngg, amdgpu_ngg, int, 0444);
 226
 227 MODULE_PARM_DESC(prim_buf_per_se, "the size of Primitive Buffer per Shader Engine (default depending on gfx)");
 228 module_param_named(prim_buf_per_se, amdgpu_prim_buf_per_se, int, 0444);
 229
 230 MODULE_PARM_DESC(pos_buf_per_se, "the size of Position Buffer per Shader Engine (default depending on gfx)");
 231 module_param_named(pos_buf_per_se, amdgpu_pos_buf_per_se, int, 0444);
 232
 233 MODULE_PARM_DESC(cntl_sb_buf_per_se, "the size of Control Sideband per Shader Engine (default depending on gfx)");
 234 module_param_named(cntl_sb_buf_per_se, amdgpu_cntl_sb_buf_per_se, int, 0444);
 235
 236 MODULE_PARM_DESC(param_buf_per_se, "the size of Off-Chip Pramater Cache per Shader Engine (default depending on gfx)");
 237 module_param_named(param_buf_per_se, amdgpu_param_buf_per_se, int, 0444);
 238
 239 MODULE_PARM_DESC(job_hang_limit, "how much time allow a job hang and not drop it (default 0)");
 240 module_param_named(job_hang_limit, amdgpu_job_hang_limit, int ,0444);
 241
 242 MODULE_PARM_DESC(lbpw, "Load Balancing Per Watt (LBPW) support (1 = enable, 0 = disable, -1 = auto)");
 243 module_param_named(lbpw, amdgpu_lbpw, int, 0444);
 244
 245 static const struct pci_device_id pciidlist[] = {
 246 #ifdef  CONFIG_DRM_AMDGPU_SI
 247         {0x1002, 0x6780, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_TAHITI},
 248         {0x1002, 0x6784, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_TAHITI},
 249         {0x1002, 0x6788, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_TAHITI},
 250         {0x1002, 0x678A, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_TAHITI},
 251         {0x1002, 0x6790, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_TAHITI},
 252         {0x1002, 0x6791, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_TAHITI},
 253         {0x1002, 0x6792, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_TAHITI},
 254         {0x1002, 0x6798, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_TAHITI},
 255         {0x1002, 0x6799, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_TAHITI},
 256         {0x1002, 0x679A, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_TAHITI},
 257         {0x1002, 0x679B, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_TAHITI},
 258         {0x1002, 0x679E, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_TAHITI},
 259         {0x1002, 0x679F, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_TAHITI},
 260         {0x1002, 0x6800, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_PITCAIRN|AMD_IS_MOBILITY},
 261         {0x1002, 0x6801, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_PITCAIRN|AMD_IS_MOBILITY},
 262         {0x1002, 0x6802, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_PITCAIRN|AMD_IS_MOBILITY},
 263         {0x1002, 0x6806, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_PITCAIRN},
 264         {0x1002, 0x6808, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_PITCAIRN},
 265         {0x1002, 0x6809, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_PITCAIRN},
 266         {0x1002, 0x6810, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_PITCAIRN},
 267         {0x1002, 0x6811, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_PITCAIRN},
 268         {0x1002, 0x6816, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_PITCAIRN},
 269         {0x1002, 0x6817, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_PITCAIRN},
 270         {0x1002, 0x6818, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_PITCAIRN},
 271         {0x1002, 0x6819, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_PITCAIRN},
 272         {0x1002, 0x6600, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_OLAND|AMD_IS_MOBILITY},
 273         {0x1002, 0x6601, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_OLAND|AMD_IS_MOBILITY},
 274         {0x1002, 0x6602, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_OLAND|AMD_IS_MOBILITY},
 275         {0x1002, 0x6603, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_OLAND|AMD_IS_MOBILITY},
 276         {0x1002, 0x6604, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_OLAND|AMD_IS_MOBILITY},
 277         {0x1002, 0x6605, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_OLAND|AMD_IS_MOBILITY},
 278         {0x1002, 0x6606, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_OLAND|AMD_IS_MOBILITY},
 279         {0x1002, 0x6607, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_OLAND|AMD_IS_MOBILITY},
 280         {0x1002, 0x6608, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_OLAND},
 281         {0x1002, 0x6610, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_OLAND},
 282         {0x1002, 0x6611, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_OLAND},
 283         {0x1002, 0x6613, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_OLAND},
 284         {0x1002, 0x6617, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_OLAND|AMD_IS_MOBILITY},
 285         {0x1002, 0x6620, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_OLAND|AMD_IS_MOBILITY},
 286         {0x1002, 0x6621, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_OLAND|AMD_IS_MOBILITY},
 287         {0x1002, 0x6623, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_OLAND|AMD_IS_MOBILITY},
 288         {0x1002, 0x6631, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_OLAND},
 289         {0x1002, 0x6820, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VERDE|AMD_IS_MOBILITY},
 290         {0x1002, 0x6821, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VERDE|AMD_IS_MOBILITY},
 291         {0x1002, 0x6822, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VERDE|AMD_IS_MOBILITY},
 292         {0x1002, 0x6823, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VERDE|AMD_IS_MOBILITY},
 293         {0x1002, 0x6824, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VERDE|AMD_IS_MOBILITY},
 294         {0x1002, 0x6825, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VERDE|AMD_IS_MOBILITY},
 295         {0x1002, 0x6826, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VERDE|AMD_IS_MOBILITY},
 296         {0x1002, 0x6827, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VERDE|AMD_IS_MOBILITY},
 297         {0x1002, 0x6828, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VERDE},
 298         {0x1002, 0x6829, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VERDE},
 299         {0x1002, 0x682A, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VERDE|AMD_IS_MOBILITY},
 300         {0x1002, 0x682B, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VERDE|AMD_IS_MOBILITY},
 301         {0x1002, 0x682C, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VERDE},
 302         {0x1002, 0x682D, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VERDE|AMD_IS_MOBILITY},
 303         {0x1002, 0x682F, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VERDE|AMD_IS_MOBILITY},
 304         {0x1002, 0x6830, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VERDE|AMD_IS_MOBILITY},
 305         {0x1002, 0x6831, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VERDE|AMD_IS_MOBILITY},
 306         {0x1002, 0x6835, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VERDE},
 307         {0x1002, 0x6837, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VERDE},
 308         {0x1002, 0x6838, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VERDE},
 309         {0x1002, 0x6839, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VERDE},
 310         {0x1002, 0x683B, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VERDE},
 311         {0x1002, 0x683D, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VERDE},
 312         {0x1002, 0x683F, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VERDE},
 313         {0x1002, 0x6660, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_HAINAN|AMD_IS_MOBILITY},
 314         {0x1002, 0x6663, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_HAINAN|AMD_IS_MOBILITY},
 315         {0x1002, 0x6664, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_HAINAN|AMD_IS_MOBILITY},
 316         {0x1002, 0x6665, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_HAINAN|AMD_IS_MOBILITY},
 317         {0x1002, 0x6667, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_HAINAN|AMD_IS_MOBILITY},
 318         {0x1002, 0x666F, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_HAINAN|AMD_IS_MOBILITY},
 319 #endif
 320 #ifdef CONFIG_DRM_AMDGPU_CIK
 321         /* Kaveri */
 322         {0x1002, 0x1304, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KAVERI|AMD_IS_MOBILITY|AMD_IS_APU},
 323         {0x1002, 0x1305, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KAVERI|AMD_IS_APU},
 324         {0x1002, 0x1306, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KAVERI|AMD_IS_MOBILITY|AMD_IS_APU},
 325         {0x1002, 0x1307, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KAVERI|AMD_IS_APU},
 326         {0x1002, 0x1309, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KAVERI|AMD_IS_MOBILITY|AMD_IS_APU},
 327         {0x1002, 0x130A, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KAVERI|AMD_IS_MOBILITY|AMD_IS_APU},
 328         {0x1002, 0x130B, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KAVERI|AMD_IS_MOBILITY|AMD_IS_APU},
 329         {0x1002, 0x130C, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KAVERI|AMD_IS_MOBILITY|AMD_IS_APU},
 330         {0x1002, 0x130D, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KAVERI|AMD_IS_MOBILITY|AMD_IS_APU},
 331         {0x1002, 0x130E, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KAVERI|AMD_IS_MOBILITY|AMD_IS_APU},
 332         {0x1002, 0x130F, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KAVERI|AMD_IS_APU},
 333         {0x1002, 0x1310, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KAVERI|AMD_IS_APU},
 334         {0x1002, 0x1311, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KAVERI|AMD_IS_APU},
 335         {0x1002, 0x1312, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KAVERI|AMD_IS_APU},
 336         {0x1002, 0x1313, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KAVERI|AMD_IS_APU},
 337         {0x1002, 0x1315, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KAVERI|AMD_IS_APU},
 338         {0x1002, 0x1316, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KAVERI|AMD_IS_APU},
 339         {0x1002, 0x1317, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KAVERI|AMD_IS_MOBILITY|AMD_IS_APU},
 340         {0x1002, 0x1318, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KAVERI|AMD_IS_MOBILITY|AMD_IS_APU},
 341         {0x1002, 0x131B, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KAVERI|AMD_IS_APU},
 342         {0x1002, 0x131C, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KAVERI|AMD_IS_APU},
 343         {0x1002, 0x131D, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KAVERI|AMD_IS_APU},
 344         /* Bonaire */
 345         {0x1002, 0x6640, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_BONAIRE|AMD_IS_MOBILITY},
 346         {0x1002, 0x6641, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_BONAIRE|AMD_IS_MOBILITY},
 347         {0x1002, 0x6646, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_BONAIRE|AMD_IS_MOBILITY},
 348         {0x1002, 0x6647, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_BONAIRE|AMD_IS_MOBILITY},
 349         {0x1002, 0x6649, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_BONAIRE},
 350         {0x1002, 0x6650, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_BONAIRE},
 351         {0x1002, 0x6651, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_BONAIRE},
 352         {0x1002, 0x6658, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_BONAIRE},
 353         {0x1002, 0x665c, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_BONAIRE},
 354         {0x1002, 0x665d, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_BONAIRE},
 355         {0x1002, 0x665f, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_BONAIRE},
 356         /* Hawaii */
 357         {0x1002, 0x67A0, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_HAWAII},
 358         {0x1002, 0x67A1, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_HAWAII},
 359         {0x1002, 0x67A2, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_HAWAII},
 360         {0x1002, 0x67A8, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_HAWAII},
 361         {0x1002, 0x67A9, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_HAWAII},
 362         {0x1002, 0x67AA, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_HAWAII},
 363         {0x1002, 0x67B0, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_HAWAII},
 364         {0x1002, 0x67B1, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_HAWAII},
 365         {0x1002, 0x67B8, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_HAWAII},
 366         {0x1002, 0x67B9, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_HAWAII},
 367         {0x1002, 0x67BA, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_HAWAII},
 368         {0x1002, 0x67BE, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_HAWAII},
 369         /* Kabini */
 370         {0x1002, 0x9830, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KABINI|AMD_IS_MOBILITY|AMD_IS_APU},
 371         {0x1002, 0x9831, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KABINI|AMD_IS_APU},
 372         {0x1002, 0x9832, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KABINI|AMD_IS_MOBILITY|AMD_IS_APU},
 373         {0x1002, 0x9833, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KABINI|AMD_IS_APU},
 374         {0x1002, 0x9834, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KABINI|AMD_IS_MOBILITY|AMD_IS_APU},
 375         {0x1002, 0x9835, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KABINI|AMD_IS_APU},
 376         {0x1002, 0x9836, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KABINI|AMD_IS_MOBILITY|AMD_IS_APU},
 377         {0x1002, 0x9837, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KABINI|AMD_IS_APU},
 378         {0x1002, 0x9838, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KABINI|AMD_IS_MOBILITY|AMD_IS_APU},
 379         {0x1002, 0x9839, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KABINI|AMD_IS_MOBILITY|AMD_IS_APU},
 380         {0x1002, 0x983a, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KABINI|AMD_IS_APU},
 381         {0x1002, 0x983b, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KABINI|AMD_IS_MOBILITY|AMD_IS_APU},
 382         {0x1002, 0x983c, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KABINI|AMD_IS_APU},
 383         {0x1002, 0x983d, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KABINI|AMD_IS_APU},
 384         {0x1002, 0x983e, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KABINI|AMD_IS_APU},
 385         {0x1002, 0x983f, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KABINI|AMD_IS_APU},
 386         /* mullins */
 387         {0x1002, 0x9850, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_MULLINS|AMD_IS_MOBILITY|AMD_IS_APU},
 388         {0x1002, 0x9851, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_MULLINS|AMD_IS_MOBILITY|AMD_IS_APU},
 389         {0x1002, 0x9852, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_MULLINS|AMD_IS_MOBILITY|AMD_IS_APU},
 390         {0x1002, 0x9853, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_MULLINS|AMD_IS_MOBILITY|AMD_IS_APU},
 391         {0x1002, 0x9854, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_MULLINS|AMD_IS_MOBILITY|AMD_IS_APU},
 392         {0x1002, 0x9855, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_MULLINS|AMD_IS_MOBILITY|AMD_IS_APU},
 393         {0x1002, 0x9856, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_MULLINS|AMD_IS_MOBILITY|AMD_IS_APU},
 394         {0x1002, 0x9857, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_MULLINS|AMD_IS_MOBILITY|AMD_IS_APU},
 395         {0x1002, 0x9858, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_MULLINS|AMD_IS_MOBILITY|AMD_IS_APU},
 396         {0x1002, 0x9859, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_MULLINS|AMD_IS_MOBILITY|AMD_IS_APU},
 397         {0x1002, 0x985A, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_MULLINS|AMD_IS_MOBILITY|AMD_IS_APU},
 398         {0x1002, 0x985B, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_MULLINS|AMD_IS_MOBILITY|AMD_IS_APU},
 399         {0x1002, 0x985C, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_MULLINS|AMD_IS_MOBILITY|AMD_IS_APU},
 400         {0x1002, 0x985D, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_MULLINS|AMD_IS_MOBILITY|AMD_IS_APU},
 401         {0x1002, 0x985E, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_MULLINS|AMD_IS_MOBILITY|AMD_IS_APU},
 402         {0x1002, 0x985F, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_MULLINS|AMD_IS_MOBILITY|AMD_IS_APU},
 403 #endif
 404         /* topaz */
 405         {0x1002, 0x6900, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_TOPAZ},
 406         {0x1002, 0x6901, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_TOPAZ},
 407         {0x1002, 0x6902, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_TOPAZ},
 408         {0x1002, 0x6903, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_TOPAZ},
 409         {0x1002, 0x6907, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_TOPAZ},
 410         /* tonga */
 411         {0x1002, 0x6920, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_TONGA},
 412         {0x1002, 0x6921, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_TONGA},
 413         {0x1002, 0x6928, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_TONGA},
 414         {0x1002, 0x6929, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_TONGA},
 415         {0x1002, 0x692B, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_TONGA},
 416         {0x1002, 0x692F, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_TONGA},
 417         {0x1002, 0x6930, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_TONGA},
 418         {0x1002, 0x6938, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_TONGA},
 419         {0x1002, 0x6939, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_TONGA},
 420         /* fiji */
 421         {0x1002, 0x7300, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_FIJI},
 422         {0x1002, 0x730F, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_FIJI},
 423         /* carrizo */
 424         {0x1002, 0x9870, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_CARRIZO|AMD_IS_APU},
 425         {0x1002, 0x9874, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_CARRIZO|AMD_IS_APU},
 426         {0x1002, 0x9875, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_CARRIZO|AMD_IS_APU},
 427         {0x1002, 0x9876, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_CARRIZO|AMD_IS_APU},
 428         {0x1002, 0x9877, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_CARRIZO|AMD_IS_APU},
 429         /* stoney */
 430         {0x1002, 0x98E4, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_STONEY|AMD_IS_APU},
 431         /* Polaris11 */
 432         {0x1002, 0x67E0, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_POLARIS11},
 433         {0x1002, 0x67E3, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_POLARIS11},
 434         {0x1002, 0x67E8, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_POLARIS11},
 435         {0x1002, 0x67EB, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_POLARIS11},
 436         {0x1002, 0x67EF, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_POLARIS11},
 437         {0x1002, 0x67FF, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_POLARIS11},
 438         {0x1002, 0x67E1, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_POLARIS11},
 439         {0x1002, 0x67E7, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_POLARIS11},
 440         {0x1002, 0x67E9, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_POLARIS11},
 441         /* Polaris10 */
 442         {0x1002, 0x67C0, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_POLARIS10},
 443         {0x1002, 0x67C1, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_POLARIS10},
 444         {0x1002, 0x67C2, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_POLARIS10},
 445         {0x1002, 0x67C4, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_POLARIS10},
 446         {0x1002, 0x67C7, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_POLARIS10},
 447         {0x1002, 0x67D0, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_POLARIS10},
 448         {0x1002, 0x67DF, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_POLARIS10},
 449         {0x1002, 0x67C8, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_POLARIS10},
 450         {0x1002, 0x67C9, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_POLARIS10},
 451         {0x1002, 0x67CA, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_POLARIS10},
 452         {0x1002, 0x67CC, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_POLARIS10},
 453         {0x1002, 0x67CF, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_POLARIS10},
 454         /* Polaris12 */
 455         {0x1002, 0x6980, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_POLARIS12},
 456         {0x1002, 0x6981, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_POLARIS12},
 457         {0x1002, 0x6985, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_POLARIS12},
 458         {0x1002, 0x6986, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_POLARIS12},
 459         {0x1002, 0x6987, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_POLARIS12},
 460         {0x1002, 0x6995, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_POLARIS12},
 461         {0x1002, 0x699F, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_POLARIS12},
 462         /* Vega 10 */
 463         {0x1002, 0x6860, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VEGA10|AMD_EXP_HW_SUPPORT},
 464         {0x1002, 0x6861, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VEGA10|AMD_EXP_HW_SUPPORT},
 465         {0x1002, 0x6862, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VEGA10|AMD_EXP_HW_SUPPORT},
 466         {0x1002, 0x6863, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VEGA10|AMD_EXP_HW_SUPPORT},
 467         {0x1002, 0x6864, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VEGA10|AMD_EXP_HW_SUPPORT},
 468         {0x1002, 0x6867, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VEGA10|AMD_EXP_HW_SUPPORT},
 469         {0x1002, 0x6868, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VEGA10|AMD_EXP_HW_SUPPORT},
 470         {0x1002, 0x686c, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VEGA10|AMD_EXP_HW_SUPPORT},
 471         {0x1002, 0x687f, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VEGA10|AMD_EXP_HW_SUPPORT},
 472         /* Raven */
 473         {0x1002, 0x15dd, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_RAVEN|AMD_IS_APU|AMD_EXP_HW_SUPPORT},
 474
 475         {0, 0, 0}
 476 };
 477
 478 MODULE_DEVICE_TABLE(pci, pciidlist);
 479
 480 static struct drm_driver kms_driver;
 481
 482 static int amdgpu_kick_out_firmware_fb(struct pci_dev *pdev)
 483 {
 484         struct apertures_struct *ap;
 485         bool primary = false;
 486
 487         ap = alloc_apertures(1);
 488         if (!ap)
 489                 return -ENOMEM;
 490
 491         ap->ranges[0].base = pci_resource_start(pdev, 0);
 492         ap->ranges[0].size = pci_resource_len(pdev, 0);
 493
 494 #ifdef CONFIG_X86
 495         primary = pdev->resource[PCI_ROM_RESOURCE].flags & IORESOURCE_ROM_SHADOW;
 496 #endif
 497         drm_fb_helper_remove_conflicting_framebuffers(ap, "amdgpudrmfb", primary);
 498         kfree(ap);
 499
 500         return 0;
 501 }
 502
 503 static int amdgpu_pci_probe(struct pci_dev *pdev,
 504                             const struct pci_device_id *ent)
 505 {
 506         unsigned long flags = ent->driver_data;
 507         int ret;
 508
 509         if ((flags & AMD_EXP_HW_SUPPORT) && !amdgpu_exp_hw_support) {
 510                 DRM_INFO("This hardware requires experimental hardware support.\n"
 511                          "See modparam exp_hw_support\n");
 512                 return -ENODEV;
 513         }
 514
 515         /*
 516          * Initialize amdkfd before starting radeon. If it was not loaded yet,
 517          * defer radeon probing
 518          */
 519         ret = amdgpu_amdkfd_init();
 520         if (ret == -EPROBE_DEFER)
 521                 return ret;
 522
 523         /* Get rid of things like offb */
 524         ret = amdgpu_kick_out_firmware_fb(pdev);
 525         if (ret)
 526                 return ret;
 527
 528         return drm_get_pci_dev(pdev, ent, &kms_driver);
 529 }
 530
 531 static void
 532 amdgpu_pci_remove(struct pci_dev *pdev)
 533 {
 534         struct drm_device *dev = pci_get_drvdata(pdev);
 535
 536         drm_put_dev(dev);
 537 }
 538
 539 static void
 540 amdgpu_pci_shutdown(struct pci_dev *pdev)
 541 {
 542         struct drm_device *dev = pci_get_drvdata(pdev);
 543         struct amdgpu_device *adev = dev->dev_private;
 544
 545         /* if we are running in a VM, make sure the device
 546          * torn down properly on reboot/shutdown.
 547          * unfortunately we can't detect certain
 548          * hypervisors so just do this all the time.
 549          */
 550         amdgpu_suspend(adev);
 551 }
 552
 553 static int amdgpu_pmops_suspend(struct device *dev)
 554 {
 555         struct pci_dev *pdev = to_pci_dev(dev);
 556
 557         struct drm_device *drm_dev = pci_get_drvdata(pdev);
 558         return amdgpu_device_suspend(drm_dev, true, true);
 559 }
 560
 561 static int amdgpu_pmops_resume(struct device *dev)
 562 {
 563         struct pci_dev *pdev = to_pci_dev(dev);
 564         struct drm_device *drm_dev = pci_get_drvdata(pdev);
 565
 566         /* GPU comes up enabled by the bios on resume */
 567         if (amdgpu_device_is_px(drm_dev)) {
 568                 pm_runtime_disable(dev);
 569                 pm_runtime_set_active(dev);
 570                 pm_runtime_enable(dev);
 571         }
 572
 573         return amdgpu_device_resume(drm_dev, true, true);
 574 }
 575
 576 static int amdgpu_pmops_freeze(struct device *dev)
 577 {
 578         struct pci_dev *pdev = to_pci_dev(dev);
 579
 580         struct drm_device *drm_dev = pci_get_drvdata(pdev);
 581         return amdgpu_device_suspend(drm_dev, false, true);
 582 }
 583
 584 static int amdgpu_pmops_thaw(struct device *dev)
 585 {
 586         struct pci_dev *pdev = to_pci_dev(dev);
 587
 588         struct drm_device *drm_dev = pci_get_drvdata(pdev);
 589         return amdgpu_device_resume(drm_dev, false, true);
 590 }
 591
 592 static int amdgpu_pmops_poweroff(struct device *dev)
 593 {
 594         struct pci_dev *pdev = to_pci_dev(dev);
 595
 596         struct drm_device *drm_dev = pci_get_drvdata(pdev);
 597         return amdgpu_device_suspend(drm_dev, true, true);
 598 }
 599
 600 static int amdgpu_pmops_restore(struct device *dev)
 601 {
 602         struct pci_dev *pdev = to_pci_dev(dev);
 603
 604         struct drm_device *drm_dev = pci_get_drvdata(pdev);
 605         return amdgpu_device_resume(drm_dev, false, true);
 606 }
 607
 608 static int amdgpu_pmops_runtime_suspend(struct device *dev)
 609 {
 610         struct pci_dev *pdev = to_pci_dev(dev);
 611         struct drm_device *drm_dev = pci_get_drvdata(pdev);
 612         int ret;
 613
 614         if (!amdgpu_device_is_px(drm_dev)) {
 615                 pm_runtime_forbid(dev);
 616                 return -EBUSY;
 617         }
 618
 619         drm_dev->switch_power_state = DRM_SWITCH_POWER_CHANGING;
 620         drm_kms_helper_poll_disable(drm_dev);
 621         vga_switcheroo_set_dynamic_switch(pdev, VGA_SWITCHEROO_OFF);
 622
 623         ret = amdgpu_device_suspend(drm_dev, false, false);
 624         pci_save_state(pdev);
 625         pci_disable_device(pdev);
 626         pci_ignore_hotplug(pdev);
 627         if (amdgpu_is_atpx_hybrid())
 628                 pci_set_power_state(pdev, PCI_D3cold);
 629         else if (!amdgpu_has_atpx_dgpu_power_cntl())
 630                 pci_set_power_state(pdev, PCI_D3hot);
 631         drm_dev->switch_power_state = DRM_SWITCH_POWER_DYNAMIC_OFF;
 632
 633         return 0;
 634 }
 635
 636 static int amdgpu_pmops_runtime_resume(struct device *dev)
 637 {
 638         struct pci_dev *pdev = to_pci_dev(dev);
 639         struct drm_device *drm_dev = pci_get_drvdata(pdev);
 640         int ret;
 641
 642         if (!amdgpu_device_is_px(drm_dev))
 643                 return -EINVAL;
 644
 645         drm_dev->switch_power_state = DRM_SWITCH_POWER_CHANGING;
 646
 647         if (amdgpu_is_atpx_hybrid() ||
 648             !amdgpu_has_atpx_dgpu_power_cntl())
 649                 pci_set_power_state(pdev, PCI_D0);
 650         pci_restore_state(pdev);
 651         ret = pci_enable_device(pdev);
 652         if (ret)
 653                 return ret;
 654         pci_set_master(pdev);
 655
 656         ret = amdgpu_device_resume(drm_dev, false, false);
 657         drm_kms_helper_poll_enable(drm_dev);
 658         vga_switcheroo_set_dynamic_switch(pdev, VGA_SWITCHEROO_ON);
 659         drm_dev->switch_power_state = DRM_SWITCH_POWER_ON;
 660         return 0;
 661 }
 662
 663 static int amdgpu_pmops_runtime_idle(struct device *dev)
 664 {
 665         struct pci_dev *pdev = to_pci_dev(dev);
 666         struct drm_device *drm_dev = pci_get_drvdata(pdev);
 667         struct drm_crtc *crtc;
 668
 669         if (!amdgpu_device_is_px(drm_dev)) {
 670                 pm_runtime_forbid(dev);
 671                 return -EBUSY;
 672         }
 673
 674         list_for_each_entry(crtc, &drm_dev->mode_config.crtc_list, head) {
 675                 if (crtc->enabled) {
 676                         DRM_DEBUG_DRIVER("failing to power off - crtc active\n");
 677                         return -EBUSY;
 678                 }
 679         }
 680
 681         pm_runtime_mark_last_busy(dev);
 682         pm_runtime_autosuspend(dev);
 683         /* we don't want the main rpm_idle to call suspend - we want to autosuspend */
 684         return 1;
 685 }
 686
 687 long amdgpu_drm_ioctl(struct file *filp,
 688                       unsigned int cmd, unsigned long arg)
 689 {
 690         struct drm_file *file_priv = filp->private_data;
 691         struct drm_device *dev;
 692         long ret;
 693         dev = file_priv->minor->dev;
 694         ret = pm_runtime_get_sync(dev->dev);
 695         if (ret < 0)
 696                 return ret;
 697
 698         ret = drm_ioctl(filp, cmd, arg);
 699
 700         pm_runtime_mark_last_busy(dev->dev);
 701         pm_runtime_put_autosuspend(dev->dev);
 702         return ret;
 703 }
 704
 705 static const struct dev_pm_ops amdgpu_pm_ops = {
 706         .suspend = amdgpu_pmops_suspend,
 707         .resume = amdgpu_pmops_resume,
 708         .freeze = amdgpu_pmops_freeze,
 709         .thaw = amdgpu_pmops_thaw,
 710         .poweroff = amdgpu_pmops_poweroff,
 711         .restore = amdgpu_pmops_restore,
 712         .runtime_suspend = amdgpu_pmops_runtime_suspend,
 713         .runtime_resume = amdgpu_pmops_runtime_resume,
 714         .runtime_idle = amdgpu_pmops_runtime_idle,
 715 };
 716
 717 static const struct file_operations amdgpu_driver_kms_fops = {
 718         .owner = THIS_MODULE,
 719         .open = drm_open,
 720         .release = drm_release,
 721         .unlocked_ioctl = amdgpu_drm_ioctl,
 722         .mmap = amdgpu_mmap,
 723         .poll = drm_poll,
 724         .read = drm_read,
 725 #ifdef CONFIG_COMPAT
 726         .compat_ioctl = amdgpu_kms_compat_ioctl,
 727 #endif
 728 };
 729
 730 static bool
 731 amdgpu_get_crtc_scanout_position(struct drm_device *dev, unsigned int pipe,
 732                                  bool in_vblank_irq, int *vpos, int *hpos,
 733                                  ktime_t *stime, ktime_t *etime,
 734                                  const struct drm_display_mode *mode)
 735 {
 736         return amdgpu_get_crtc_scanoutpos(dev, pipe, 0, vpos, hpos,
 737                                           stime, etime, mode);
 738 }
 739
 740 static struct drm_driver kms_driver = {
 741         .driver_features =
 742             DRIVER_USE_AGP |
 743             DRIVER_HAVE_IRQ | DRIVER_IRQ_SHARED | DRIVER_GEM |
 744             DRIVER_PRIME | DRIVER_RENDER | DRIVER_MODESET,
 745         .load = amdgpu_driver_load_kms,
 746         .open = amdgpu_driver_open_kms,
 747         .postclose = amdgpu_driver_postclose_kms,
 748         .lastclose = amdgpu_driver_lastclose_kms,
 749         .set_busid = drm_pci_set_busid,
 750         .unload = amdgpu_driver_unload_kms,
 751         .get_vblank_counter = amdgpu_get_vblank_counter_kms,
 752         .enable_vblank = amdgpu_enable_vblank_kms,
 753         .disable_vblank = amdgpu_disable_vblank_kms,
 754         .get_vblank_timestamp = drm_calc_vbltimestamp_from_scanoutpos,
 755         .get_scanout_position = amdgpu_get_crtc_scanout_position,
 756 #if defined(CONFIG_DEBUG_FS)
 757         .debugfs_init = amdgpu_debugfs_init,
 758 #endif
 759         .irq_preinstall = amdgpu_irq_preinstall,
 760         .irq_postinstall = amdgpu_irq_postinstall,
 761         .irq_uninstall = amdgpu_irq_uninstall,
 762         .irq_handler = amdgpu_irq_handler,
 763         .ioctls = amdgpu_ioctls_kms,
 764         .gem_free_object_unlocked = amdgpu_gem_object_free,
 765         .gem_open_object = amdgpu_gem_object_open,
 766         .gem_close_object = amdgpu_gem_object_close,
 767         .dumb_create = amdgpu_mode_dumb_create,
 768         .dumb_map_offset = amdgpu_mode_dumb_mmap,
 769         .dumb_destroy = drm_gem_dumb_destroy,
 770         .fops = &amdgpu_driver_kms_fops,
 771
 772         .prime_handle_to_fd = drm_gem_prime_handle_to_fd,
 773         .prime_fd_to_handle = drm_gem_prime_fd_to_handle,
 774         .gem_prime_export = amdgpu_gem_prime_export,
 775         .gem_prime_import = drm_gem_prime_import,
 776         .gem_prime_pin = amdgpu_gem_prime_pin,
 777         .gem_prime_unpin = amdgpu_gem_prime_unpin,
 778         .gem_prime_res_obj = amdgpu_gem_prime_res_obj,
 779         .gem_prime_get_sg_table = amdgpu_gem_prime_get_sg_table,
 780         .gem_prime_import_sg_table = amdgpu_gem_prime_import_sg_table,
 781         .gem_prime_vmap = amdgpu_gem_prime_vmap,
 782         .gem_prime_vunmap = amdgpu_gem_prime_vunmap,
 783
 784         .name = DRIVER_NAME,
 785         .desc = DRIVER_DESC,
 786         .date = DRIVER_DATE,
 787         .major = KMS_DRIVER_MAJOR,
 788         .minor = KMS_DRIVER_MINOR,
 789         .patchlevel = KMS_DRIVER_PATCHLEVEL,
 790 };
 791
 792 static struct drm_driver *driver;
 793 static struct pci_driver *pdriver;
 794
 795 static struct pci_driver amdgpu_kms_pci_driver = {
 796         .name = DRIVER_NAME,
 797         .id_table = pciidlist,
 798         .probe = amdgpu_pci_probe,
 799         .remove = amdgpu_pci_remove,
 800         .shutdown = amdgpu_pci_shutdown,
 801         .driver.pm = &amdgpu_pm_ops,
 802 };
 803
 804
 805
 806 static int __init amdgpu_init(void)
 807 {
 808         int r;
 809
 810         r = amdgpu_sync_init();
 811         if (r)
 812                 goto error_sync;
 813
 814         r = amdgpu_fence_slab_init();
 815         if (r)
 816                 goto error_fence;
 817
 818         r = amd_sched_fence_slab_init();
 819         if (r)
 820                 goto error_sched;
 821
 822         if (vgacon_text_force()) {
 823                 DRM_ERROR("VGACON disables amdgpu kernel modesetting.\n");
 824                 return -EINVAL;
 825         }
 826         DRM_INFO("amdgpu kernel modesetting enabled.\n");
 827         driver = &kms_driver;
 828         pdriver = &amdgpu_kms_pci_driver;
 829         driver->num_ioctls = amdgpu_max_kms_ioctl;
 830         amdgpu_register_atpx_handler();
 831         /* let modprobe override vga console setting */
 832         return drm_pci_init(driver, pdriver);
 833
 834 error_sched:
 835         amdgpu_fence_slab_fini();
 836
 837 error_fence:
 838         amdgpu_sync_fini();
 839
 840 error_sync:
 841         return r;
 842 }
 843
 844 static void __exit amdgpu_exit(void)
 845 {
 846         amdgpu_amdkfd_fini();
 847         drm_pci_exit(driver, pdriver);
 848         amdgpu_unregister_atpx_handler();
 849         amdgpu_sync_fini();
 850         amd_sched_fence_slab_fini();
 851         amdgpu_fence_slab_fini();
 852 }
 853
 854 module_init(amdgpu_init);
 855 module_exit(amdgpu_exit);
 856
 857 MODULE_AUTHOR(DRIVER_AUTHOR);
 858 MODULE_DESCRIPTION(DRIVER_DESC);
 859 MODULE_LICENSE("GPL and additional rights");